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SPI 的通信速率和通信数据长度都是可编程的。
判断题
2019-04-21 22:46:59
0
207
A.错误
B.正确
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科目:
数字信号处理器原理及应用
学科:
信息与通信工程
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在增强的FIFO缓冲模式下,用户可以建立32级深度的发送和接收缓冲。
在许多运动/电机和功率电子应用中,常将功率器件上下臂串联起来控制。上下被控的臂可以短时同时导通。
模数转换模块ADC排序器由两个独立的8状态排序器 (SEQ1和SEQ2)构成,这两个排序器还可以级联构成一个16状态的排序器 (SEQ)。
可屏蔽中断的响应过程实质上就是中断的产生、使能到处理的过程。
软件改变系统工作频率时,可以立即生效,无需等待。
定时器的时钟源可以取自外部输入信号(TCLKIN),QEP单元,内部时钟或者看门狗时钟。
WDPS是看门狗 控制的
DSP内核它包括处理器内核,指令缓冲器,数据存储器和程序存储器,I/O接口控制器,程序地址总线和程序数据总线,直接读取的地址总线和数据总线等单元,其中最核心的是()
CAN 总线只用了7 层模型中的
PIE 支持的 个中断
事件管理器的捕获单元用来对外部硬件信号的
SCI采用硬件对通信数据进行 检查
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当TTL与非门的输入端悬空时相当于输入为逻辑1。
RS触发器的约束条件RS=0表示不允许出现R=S=1的输入
连续“同或”199个0的结果是0。
8位移位寄存器,串行输入时经()个脉冲后,8位数码全部移入寄存器中
PLD器件的主要优点不包括()
PIE 支持的 个中断
WDPS是看门狗 控制的
由于CAN 总线是一种串行通信协议,具有较高的通信速率、较强的抗干扰能力。
正交编码脉冲电路对编码输入脉冲的上升沿和下降沿都进行计数,因此,由QEP电路产生的通用定时器的时钟输入是每个输入脉冲序列频率的4倍。
C28x 系列数字信号处理器集成了增强型CAN总线通信接口,带有16 个完全可配置邮箱和定时邮递(time-stamping)功能的增强型CAN 总线模块。
非可屏蔽中断可以通过相应的中断使能寄存器使能或禁止产生的中断。
发送和接收缓冲器使用两个FIFOs
CAN 总线可以保证在产生总线冲突情况下,具有更高优先级的消息没有延时的传输。
看门狗主要用来检测软件和硬件的运行状态,当内部计数器溢出时将产生一个复位信号。为了避免产生不必要的复位,要求用户软件周期的对看门狗定时器进行复位。
分组交换的本质包括()
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